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瑞利信道建模 (Modelisation canal de Rayleigh)

MIMO 瑞利信道 无线电信道 无线电信道建模 使用此代码中,您将看到图的一些信号的无线电通信中,例如如果我们有一个方案的移动终端与通信基站。在基站的接收的信号是波的由于流动性移动终端...
  Matlab        Matlab     

Hybirdsat求解器smt

开源的的smt求解器,用于求解约束集的可满足性,能够支持位向量的求解,速度还算不错。...
  算法        C     

作为 das 爸爸 dsfka ; 1das dsad sjh ds sdjklxchvxcraeaksdna 已有 djas jbdsabf

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  驱动        Borland C++ Builder     

rsa 执行导入 java.math。

rsa 包 ; 导入你 ; 导入 java.secUrity.SecUreRandom ; 公共类 Rsa { 私人最终的静态 BigInteger 之一 = 新 BigInteger("1") ; 私人最终静态 SecUreRandom 随机 = 新 SecUreRandom() ; 私人 BigInteger privateKey ; 私人 BigInteger 公钥 ; 私...
  Java开发        Java     

DDS_DUal_ports verilog实现

DDS_DUal_ports  verilog实现,需要的可以下载实验,也可根据自身的需要修改,以求达到自身的目的...
  Verilog      Verilog     

串口接收模块 verilog serial port receiver modUle

串口接收模块 verilog serial port receiver modUle,包含bps产生模块,电平检测模块和控制模块...
  Verilog      Verilog     

Rsa的VHDL代码

Here, we present the first available open-soUrce 512 bit Rsa core. This is an early prototype version of a fUll FIPS Certified 512-4096 capable Rsa Crypto-core which will be on sale soon. The version provided, has not the same performance than the final prodUct since it was a proof of concept tha...
  Verilog      Verilog     

SOPC技术使用 verilog编的hello 程序

SOPC技术的fpga的实现verilog硬件描述语言,编写的在niosII 程序   采用altera芯片...
  Verilog      VHDL     

1024位Rsa加密算法

 Rsa算法的描述  选取长度应该相等的两个大素数p和q,计算其乘积:                          n = pq    ...
  Verilog      Verilog     

四种亮灯方式自由切换的跑马灯(用verilog_hdl语言编写的跑马灯程序)

这是一个学习verilog HDL的好资料,适合于初学者,讲解详细,从浅入深,学好这个语言,是学习硬件描述语言的好东西,好资料!...
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verilog滤波器仿真

verilog程序仿真滤波器 16阶 运用加法器和乘法器 40KHZ 16位并入并出...
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spring 与velocity高级应用

见内容 spring 与velocity高级应用 velicity 工具类定义使用spring管理的bean...
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SQL server 的 Rsa 代码

Rsa is a 密码,这被称为第一次在切实可行范围内公钥密码系统和广泛用于安全的数据传输。在这种密码体制, 加密密钥是公开的不同于的解密密钥这保密的。在 Rsa,这种不对称性基于实际的困难保理业务的两大产品质数、 保理...
  SQL Server        C++     

bilgisayar birimleri 测试 proğramları

独特 方法提供了 详细测试 硬盘 驱动器 诊断 和质量 elektronikdUrUm 磁性表面. 根据 阅读速度 为所有 图表类型 CD 曲目 能 对得出结论 坏 bloklarınvarlıg 和 替代 跟随。 不同于其它实用程序 使用 低 取代 方法和 重要信息 工作...
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浮点乘法verilog fpga

数字乘法器,作为现代计算机中必不可少的一部分,其设计工作越来越受到人们的重视。 本文采用硬件描述语言verilog HDL设计了一个基于补码一位乘法的浮点乘法器,设计功能完善,灵活性较好。理论依据包括浮点运算和...
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AxleWeigh 2.0 是完全免费的 — — 永远 !

AxleWeigh 2.0 是一个功能齐全的轨称重系统,可以使用与全长汽车衡或传统轮轴秤。 AxleWeigh 2.0是完全自由 — — 永远! 下载AxleWeigh 和使用它的只要你喜欢 — —自由。这不是一次评价。它不是测试驱动器。它是功能完全...
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iwangyoUandloveyoU

zheshiwo sUibian xiede  nimen bUyaoxiazai meiyongde qinmen  wojiUshi weile qU xiazai qita de yUandaima ...
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Jdeveloper 程序

Jdeveloper 程序包括 web servicen, JAX-WS,存储过程、 SQL、 XML 等。...
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