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二维Rayleigh-Bénard热对流系统数值模拟

采用SIMPLE算法编写的二维Rayleigh-Bénard热对流系统数值模拟程序,对流项采用迎风格式,粘性项采用隐式中 心差分格式,所得的结果与文献中符合较好。...
  Matlab        Matlab     

瑞利信道建模 (Modelisation canal de Rayleigh)

MIMO 瑞利信道 无线电信道 无线电信道建模 使用此代码中,您将看到图的一些信号的无线电通信中,例如如果我们有一个方案的移动终端与通信基站。在基站的接收的信号是波的由于流动性移动终端...
  Matlab        Matlab     

Hybirdsat求解器smt

开源的的smt求解器,用于求解约束集的可满足性,能够支持位向量的求解,速度还算不错。...
  算法        C     

m2e + maven web 演示

1.首先修改pom.xml文件,添加servlet依赖 <project xmlns="http://maven.apache.org/POM/4.0.0" xmlns:xsi="http://www.w3.org/2001/XMLSchema-instance" xsi:schemaLocation="http://maven.apache.org/POM/4.0.0 http://maven.apache.org/maven-v4_0_0.xsd"> <modelversion>4.0.0...
  Java开发        Java     

视频运动补偿预测块的 verilog代码

这是一个关于 VLSI 设计项目。主题是压缩的视频中的运动补偿预测块设计。项目包括 RTL 代码,代码验证平台。 项目使用软件的新思科技,例如: 设计编译器 (合成)、 IC 编译器 (布局).........
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AXI协议的slaveverilog实现

AXI(Advanced eXtensible Interface)是一种总线协议,该协议是ARM公司提出的AMBA(Advanced Microcontroller BUs ArchitectUre)3.0协议中最重要的部分,是一种面向高性能、高带宽、低延迟的片内总线。它的地址/控制和数据相位是分离的,支持不...
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verilog 的展位乘数

我们要提出新的 SRAM bitcell 以较少的功率消耗,读稳定性、 面积小于现有的施密特触发器基于 SRAM 和其他现有的设计,通过新的设计相结合的虚拟接地与读取错误减少逻辑。 可调滞回 CMOS 施密特触发器 磁滞 CMOS...
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java使用JNative调用dll

读取身份证信息 //以下为主要API函数     int CVR_InitComm(int Port)                               初始化...
  Java开发        Java     

verilog for lsfr over bist

当设计的记忆与大的部分,其中包括电容对位线。两位线用于执行读和写操作,由于放电电容在写操作中的操作。7T sram 存储单元减少了活性因子的排位线对执行写操作。7T sram 存储单元减少了活性因子的排位线对执行写操作。...
  Verilog      Verilog     

verilog代码 cordic 核心

Cordic 核心的100%行为实现。其核心是通过高度可配置的定义。验证平台是包括在内的。请参阅详细信息包括的手册...
  Verilog      Verilog     

vedic 乘法器的 verilog 代码

这是古代vedic数学家设计的8 x 8 vedic乘法器的源代码旨。全加操作使用了全加法器。...
  Verilog      Verilog     

全加器verilog

一种简单的 verilog 代码为 fUll_adder 的。它是在模拟器和 xilinx spartan3E fpga 板测试。...
  Verilog      Verilog     

veriolg HDL的D触发器

D触发器程序,适合初学者使用和学习,verilog hdl语言的,使用Xillinx公司的芯片。...
  Verilog      Verilog     

8 位加法器 verilog

嘿,这里是 ise 格式代码为 xilinx 软件 verilog 的 8 位固定点编码使用此编码与测试工作台为例...
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xilinx fpga的VGA彩条显示verilog代码

verilog实现FPGA的VGA塞瑟条纹显示代码,测试完全正确,可以成功的实现功能。...
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Uart verilog代码

包括Uart收发及波特率选择的底层文件,使用任何FPGA,经过验证的verilog代码。...
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使用FPGA SPARTAN-3E 的ledbanner verilog代码

verilog 代码中使用 FPGA 斯巴达 3E Ledbanner 显示 0-9 中 2 七段显示器。 它会从左去附和胜利或反之亦然。和当按重置按钮时将重置功能。...
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2 X 2 位veDIC乘法器的设计

在这个项目中古代veDIC数学用于乘法运算。主要应用于数字信号处理器的乘数的加密算法。URTHVA TRIYAGBHYAM 佛经用来执行。UT 据说是纵向和横向的乘法。...
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verilog 写的SPI flash 模型

ST公司的M25Pxx SPI flash memory的verilog仿真模型,该模型准确地描述了SPI flash memory的行为,包括读,写,擦除等操作,可以用来挂在带有SPI接口的soc外部,方便验证SPI接口。...
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verilog Booth 型乘法器

此文件描述的 verilog booth 型乘法器的代码。源代码是模拟和验证效果会更好...
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